“楊旭總回答這個(gè)問(wèn)題時(shí)比較激動(dòng),采訪(fǎng)了那么多次,第一次看他這樣。”幾位熟悉楊旭的媒體朋友私下紛紛議論著(zhù)。

其實(shí),楊旭的激動(dòng)是可以理解的。因為許久未談尖端制造的英特爾在此次“精尖制造日”的活動(dòng)上,不但全球首次展示了“Cannon Lake”10nm晶圓,更是為制程工藝高低的標準和摩爾定律是否失效正了名。

指責對手玩數字游戲

英特爾聯(lián)合創(chuàng )始人戈登•摩爾在半世紀前提出的摩爾定律,是指每代制程工藝都要讓芯片上的晶體管數量翻一番??v觀(guān)芯片每代創(chuàng )新歷史,業(yè)界一直遵循這一定律,并按前一代制程工藝縮小約 0.7倍來(lái)對新制程節點(diǎn)命名,這種線(xiàn)性微縮意味著(zhù)晶體管密度翻番。因此,出現了90nm、65nm、45nm、32nm—每一代制程節點(diǎn)都能在給定面積上,容納比前一代多一倍的晶體管。

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在2014年英特爾推出14nm工藝之后不到一年的時(shí)間內,三星和臺積電都陸續推出了自己的14nm工藝和16nm工藝,并被蘋(píng)果用于制造iPhone 6s所搭載的A9處理器。2016年底,三星和臺積電又相繼推出了自己的10nm工藝,看起來(lái)這也比英特爾的10nm工藝早了將近十個(gè)月。

然而英特爾高級院士、技術(shù)與制造事業(yè)部制程架構與集成總監馬博(Mark Bohr)卻不認同這一看法。他不點(diǎn)名批評了競爭對手的一些做法,指出也許是因為制程進(jìn)一步的微縮越來(lái)越難,一些公司背離了摩爾定律的法則。即使晶體管密度增加很少,或者根本沒(méi)有增加,但他們仍繼續為制程工藝節點(diǎn)命新名,結果導致這些新的制節點(diǎn)名稱(chēng)根本無(wú)法體現位于摩爾定律曲線(xiàn)的正確位置。

“行業(yè)亟需一種標準化的晶體管密度指標,以便給客戶(hù)一個(gè)正確的選擇??蛻?hù)應能夠隨時(shí)比較芯片制造商不同的制程,以及各個(gè)芯片制造商的‘同代’產(chǎn)品。但半導體制程以及各種設計日益復雜使標準化更具挑戰性。”Mark Bohr說(shuō)。

他認為,無(wú)論是用柵極距(柵極寬度再加上晶體管柵極之間的間距)乘以最小金屬距(互連線(xiàn)寬度加上線(xiàn)間距),還是用柵極距乘以邏輯單元高度進(jìn)行計算,都不能真正衡量實(shí)際實(shí)現的晶體管密度,因為它們都沒(méi)有試圖說(shuō)明設計庫中不同類(lèi)型的邏輯單元及這些指標量化相對于上一代的相對密度。

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“行業(yè)真正需要的是給定面積(每平方毫米)內的晶體管絕對數量。”Mark Bohr認為,每個(gè)芯片制造商在提到制程節點(diǎn)時(shí),都應披露用這個(gè)簡(jiǎn)單公式所測算出的MTr/mm2 (每平方毫米晶體管數量(單位:百萬(wàn)))單位中邏輯晶體管密度。只有這樣,行業(yè)才可以厘清制程節點(diǎn)命名的混亂狀況,從而專(zhuān)心致志推動(dòng)摩爾定律向前發(fā)展。

揭秘史上最強10nm工藝

英特爾10nm工藝采用第三代FinFET(鰭式場(chǎng)效應晶體管)技術(shù),使用的超微縮技術(shù)(hyper scaling),充分運用了多圖案成形設計(multi-patterning schemes),使得它擁有世界上最密集的晶體管和最小的金屬間距,從而實(shí)現了業(yè)內最高的晶體管密度,領(lǐng)先其他“10nm”整整一代。

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英特爾公布的數據顯示,英特爾10nm制程的最小柵極間距從70nm縮小至54nm,且最小金屬間距從52nm縮小至36nm。這使得邏輯晶體管密度可達到每平方毫米1.008億個(gè)晶體管,是之前英特爾14nm制程的2.7倍,大約是業(yè)界其他“10nm”制程的2倍。同時(shí),芯片的die area縮小的幅度也超過(guò)了以往??梢钥吹?,22nm之前每代工藝的提升可帶來(lái)die area約0.62倍的縮減,14nm以及10nm則帶來(lái)了0.46倍和0.43倍的縮減。

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超微縮是英特爾用來(lái)描述從14nm到10nm制程,晶體管密度提高2.7倍的術(shù)語(yǔ)。超微縮為英特爾14nm和10nm制程提供了超乎常規的晶體管密度,并延長(cháng)了制程工藝的生命周期。盡管制程節點(diǎn)間的開(kāi)發(fā)時(shí)間超過(guò)兩年,但超微縮使其完全符合摩爾定律。

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縱向來(lái)看,相比之前的14nm制程,英特爾10nm制程提升了高達25%的性能和降低45%的功耗。全新增強版的10 nm制程—10++,則可將性能再提升15%或將功耗再降低。

“如果我們再橫向的與業(yè)界其他競爭友商的16/14nm制程相比,就會(huì )發(fā)現英特爾14nm制程的晶體管密度是他們的1.3倍。業(yè)界其他競爭友商10nm制程的晶體管密度與英特爾14nm制程相當,卻晚于英特爾14nm制程三年。”英特爾公司執行副總裁兼制造、運營(yíng)與銷(xiāo)售集團總裁Stacy Smith說(shuō)。

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摩爾定律不會(huì )失效

近幾年,“摩爾定律失效”是近兩年來(lái)業(yè)界討論的熱門(mén)話(huà)題。隨著(zhù)制程工藝在物理層面越來(lái)越接近極限,摩爾定律所詮釋的“當價(jià)格不變時(shí),集成電路上可容納的元器件的數目,約每隔18-24個(gè)月便會(huì )增加一倍,性能也將提升一倍”的規律逐漸被打破,使得人們對摩爾定律在未來(lái)所產(chǎn)生的指導意義產(chǎn)生強烈懷疑。

而從英特爾自身的工藝發(fā)展過(guò)程來(lái)看,又似乎從一個(gè)側面加深了人們對“摩爾定律”已經(jīng)失效的印象。2011年下半年,英特爾發(fā)布了22nm工藝;2年半之后的2014年上半年,英特爾才發(fā)布最新的14nm工藝;3年后的今天,英特爾才正式發(fā)布新一代10nm工藝。而且,在從14nm向10nm提升的過(guò)程中,英特爾此前一直秉承的Tick-Tock策略(一年提升工藝,一年提升架構)也很少再被提及。

“連英特爾這樣最頂級的芯片制造商都花了3年左右的時(shí)間去完成兩代工藝間的演進(jìn),這難道還不算失效嗎?”人們不禁要問(wèn)?

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但如果我們細心的挖掘一下就會(huì )發(fā)現,英特爾14nm與之前的22nm的命名并不是0.7倍之間的關(guān)系。也就是說(shuō),如果按照0.7倍命名規律來(lái)看,22nm的0.7倍命名應該是16nm,而不是22nm的0.64倍的14nm工藝。

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從上兩張圖可以看到,英特爾14nm工藝下的晶體管密度為37.5Mtr/mm²(百萬(wàn)晶體管/平方毫米),而這個(gè)密度是英特爾22nm工藝下晶體管密度的2.45倍。如果按照摩爾定律每?jì)赡攴环臉藴?,兩年半的周期,晶體管數量應該是需要增加2.5倍左右,所以英特爾的14nm工藝的晶體管密度也是基本符合摩爾定律要求的。

而且,從英特爾的32nm到22nm,每?jì)赡甑臅r(shí)間,晶體管密度(單位面積下晶體管的平均數量)的提升都超過(guò)了兩倍(32nm的晶體管密度是45nm的2.27倍)。雖然英特爾從22nm升級到14nm,以及從14nm升級到10nm的時(shí)間周期都超過(guò)了兩年,但是對應的晶體管密度也分別提升了2.5倍和2.7倍。

而此次英特爾發(fā)布的10nm工藝下的晶體管密度則達到了100.8Mtr/mm²,大約是上一代的14nm工藝的2.7倍,也就是說(shuō)3年左右的時(shí)間內,英特爾實(shí)現了晶體管密度2.7倍的增長(cháng),雖然略低于本該3倍的增長(cháng),但是結合此前幾代超出摩爾定律的增長(cháng),英特爾10nm工藝仍然是符合摩爾定律的對于晶體管密度的線(xiàn)性增長(cháng)要求。

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隨著(zhù)工藝的發(fā)展,制程節點(diǎn)之間的時(shí)間已經(jīng)延長(cháng),成本也更加昂貴,這是整個(gè)行業(yè)正在面臨的問(wèn)題。就算僅僅是把設備安裝到已有的晶圓廠(chǎng)中,就要花費70億美元,越來(lái)越少的公司可以承擔得起推進(jìn)摩爾定律的成本。

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但這并不意味著(zhù)摩爾定律已經(jīng)失效。Stacy Smith表示,每一個(gè)節點(diǎn)晶體管數量會(huì )增加一倍,14nm和10nm都做到了,而且晶體管成本下降幅度前所未有,這表示摩爾定律仍然有效。如果再加上創(chuàng )新技術(shù),可以保證摩爾定律長(cháng)期有效。

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此外,為了推動(dòng)摩爾定律在未來(lái)的繼續前進(jìn),以及可能的后摩爾時(shí)代的到來(lái)。英特爾還積極研究如nm線(xiàn)晶體管、III-V 材料(如砷化鎵和磷化銦)晶體管、硅晶片的3D堆疊、高密度內存、紫外光(EUV)光刻技術(shù)、自旋電子(一種超越CMOS的技術(shù),當CMOS無(wú)法再進(jìn)行微縮的時(shí)候,這是一種選擇,可提供非常密集和低功耗的電路)、神經(jīng)元計算等前沿項目。